Оперативное ЗУ организовано как массив элементарных ячеек памяти, к которым обеспечивается произвольный доступ. Каждая ячейка имеет уникальный адрес, позволяющий разли­чать ячейки при обращении к ним для выполнения операций записи и считыва­ния. Для традиционных типов ОЗУ на базе DRAM характерна энергозависимость – даже при кратковременном прерывании питания хранимая информация теряется. Поэтому в рабочем состоянии микросхемы ОЗУ должны быть постоянно подключены к источнику питания.

Ячейки динамической памяти объединяются в двумерную матрицу, где каждая ячейка адресуется номерами строки и столбца, на пересечении которых она находится. К микросхемам памяти подводятся шины управления, адреса и данных, которые используются для передачи соответственно команд (управляющих работой микросхем памяти), адресов строк и столбцов, данных (подробнее об указанных шинах см. в разделе 5). При матричной организации микросхем памяти реализуется координат­ный принцип адресации ячеек. Адрес ячейки, поступающий по шине адреса ВМ, пропускается через блок логики выбора, где он разделяется на две составляющие: адрес строки и адрес столбца. Адреса строки и столбца запоминаются соответственно в регистре адреса строки и регистре адреса столбца микросхемы. Регистры соеди­нены каждый со своим дешифратором. Выходы дешифраторов образуют систему горизонтальных и вертикальных линий, к которым подсоединены запоминающие элементы матрицы, при этом каждый запоминающий элемент расположен на пересечении одной гори­зонтальной и одной вертикальной линии. Запоминающие элементы, объединенные общим «горизонтальным» проводом, принято называть стро­кой (row). Запоминающие элементы, подключенные к общему «вертикальному» проводу, называют столбцом (column). Фактически «вертикальных» проводов в микросхеме должно быть, по крайней мере, вдвое больше, чем это требуется для адресации, поскольку к каждому запоминающему элементу необходимо подключить линию, по которой будет передаваться считанная и записываемая информация.